时钟/数据扇出缓冲器,2:1:20 差分,HSTL / ECL / PECL,2.5 V / 3.3 V

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NB100LVEP221 是一款低歪曲率 2:1:20 差分驱动器,适用于时钟分发,将两个时钟源接受到一个输入多路复用器中。两个时钟输入为差分 ECL/PECL;CLK1/CLK1bar 还可接收 HSTL 信号电平。LVPECL 输入信号可以为差分或单端(如果使用 VBB 输出)。LVEP221 专门保证输出对输出的低歪曲率。绝佳的设计、布局和处理技术将器件内部、器件到器件的歪曲率降到了最低。为了确保最严格的歪曲率,差分输出的两侧均同样端接到 50Ω,即使只使用一侧也是如此。如不使用某个输出对,可将两个输出保持开路(无端接),而不影响歪曲率。与大多数其他 ECL 器件一样,NB100LVEP221 可在 LVPECL 模式下由正向 VCC 电源供电。因此,在 +3.3 V 或 +2.5 V 系统中使用 LVEP221,可实现高性能的时钟分发。在 PECL 环境中,通常使用串行或戴维南线路终端,因为它们无需额外的电源。有关使用 PECL 端接的更多信息,设计人员应参考应用注释 AND8020/D。仅为此器件提供 VBB 引脚,即内部产生的供应电压。对于单端 LVPECL 输入的情况,将未使用的差分输入联接至 VBB,作为开关参考电压。VBB 还可将 AC 耦合输入重偏置。使用时,通过一个 0.01 uF 电容将 VBB 和 VCC 去耦合,并限制源或汲 0.5 mA 的电流。不使用时,VBB 应保持开路。单端 CLK 输入运行在 LVPECL 模式下仅限于 VCC >= 3.0 V,在 NECL 模式下仅限于 VEE <= -3.0 V。

  • Multiple Clock Sources
  • 15 ps Typical Output-to-Output Skew
  • 40 ps Typical Device-to-Device Skew
  • Jitter Less than 2 ps RMS
  • Maximum Frequency > 1.0 Ghz Typical
  • VBB Output
  • 540 ps Typical Propagation Delay
  • LVPECL and HSTL Mode Operating Range: VCC = 2.375 V to 3.8 V with VEE = 0 V
  • NECL Mode Operating Range: VCC = 0 V with VEE = -2.375 V to -3.8 V
  • Q Output will Default Low with Inputs Open or at VEE

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Input / Output Ratio

Input Level

Output Level

VCC Typ (V)

tJitterRMS Typ (ps)

tskew(o-o) Max (ps)

tpd Typ (ns)

tR & tF Max (ps)

fmaxClock Typ (MHz)

fmaxData Typ (Mbps)

Reference Price

NB100LVEP221MNRG

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CAD Model

Pb

A

H

P

QFN-52

2

260

REEL

2000

Y

Buffer

1

2:1:20

LVDS

ECL

3.3

1

50

0.59

300

1000

-

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