D Flip-Flops and JK Flip-Flops | MC74AC377
概览
MC74AC377/74ACT377 具有八个边触发 D 型触发器， 带单独的 D 输入和 Q 输出。公共缓冲时钟 (CP) 输入将在时钟启用 (CE) 为低电平时同时加载所有 触发器。寄存器完全为边触发。低-高时钟转换之前每个 D 输入的状态、 一个设置时间传输到相应触发器的 Q 输出。CE 输入必须在低电平-高电平时钟转换之前稳定一个设置时段， 才能实现可预测运行。
- Ideal for Addressable Register Applications
- Clock Enable for Address and Data Synchronization Applications
- Eight Edge-Triggered D Flip-Flops
- Buffered Common Clock
- Outputs Source/Sink 24 mA
- See MC74AC273 for Master Reset Version
- See MC74AC373 for Transparent Latch Version
- See MC74AC374 for 3-State Version
- ACT377 Has TTL Compatible Inputs
- Pb-Free Packages are Available
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