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3.3 V ECL 可编程延迟芯片,带 FTUNE
Active, Not Rec
MC100EP196B 是一款可编程延迟芯片 (PDC),主要用于时钟去歪曲和计时调整。它提供了差分 NECL/PECL 输入转换的可变延迟。它与 EP195 结构相似,但使用 FTUNE 引脚增加了延迟中的进一步微调功能。FTUNE 输入采用从 VCC 到 VEE 的模拟电压来微调输出延迟,其范围为 0 到 60 ps。延迟部分由一个可编程的门极和多工器矩阵组成,如图 2 逻辑图所示。 EP196B 延迟增量的可数字选择分辨率约为 10 ps, 净范围最高 10.4 ns。所需延迟由 10 个数据选择输入 D(9:0) 值选择,由 LEN(引脚 10)控制。LEN 上的低电平可实现 D(9:0) 确定的实时延迟值的透明加载模式。LEN 上的低电平-高电平转换将针对 D(10:0) 中的任何后续变化锁定并保持现有电流值。表 6 和图 3 中显示了与 D0 (LSB) 至 D9 (MSB) 相关联的各种抽头数的恰当延迟值。
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CAD Models
Compliance
Package Type
Case Outline
MSL Type
MSL Temp (°C)
Container Type
Container Qty.
ON Target
Input Level
Output Level
VCC Typ (V)
fMax Typ (MHz)
td(prog) Min (ns)
td(prog) Max (ns)
td(step) Typ (ps)
tJitter Typ (ps)
tR & tF Max (ps)
Reference Price
Active, Not Rec
Pb
A
H
P
QFN-32
2
260
TUBE
74
Y
CML
ECL
LVDS
ECL
3.3
1200
8.95
12.11
11
2.6
210
Price N/A
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可靠性数据
Die Related Summary Data
Device: MC100EP196BMNG
Equivalent to wafer fab process: MOSAIC
产品技术
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等效器件小时
平均故障间隔时间/平均无故障时间(按小时计算)
FITS
MOSAIC
0
476668904
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Re-calculate Data
Data is based on the following assumptions.
Note: The temperature and confidence level may be adjusted to your requirements.
Disclaimer: A reliability FIT rate calculated using this tool shall not be used for any functional safety purpose. In case a raw FIT rate needs to be estimated for a component which is targeted to be used in a safety critical application (i.e. compliant to ISO 26262 standard) it should be calculated according to generic safety standards (IEC62380, IEC61709, SN29500, FIDES, etc.)