时钟驱动器,1:5 差分,ECL / HSTL,3.3 V / 5.0 V

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MC100EP14 是一款低歪曲率 1:5 差分驱动器,在设计时考虑到时钟分配,将两个时钟源集中到一个输入 多路复用器中。ECL/PECL 输入信号可以是差分或单端的(若使用 VBB 输出)。当 LVEP14 在 PECL 条件下运行时,可使用 HSTL 输入。EP14 专门保证低输出到输出歪曲率。最优的设计、布局和处理可最大程度地降低器件内部以及器件之间的歪曲率。为了确保达到严格的歪曲率规范,即使只使用一个输出,差分输出的两端也都需要端接。如果未使用输出对,则两个输出都可以保持开路(无端接),而不影响歪曲率。公共启用 (ENbar) 是同步的,输出在低电平状态下启用/禁用。这样可避免在启用/禁用设备时出现欠幅时钟脉冲,这种情况可能发生在异步控制中。内部触发器在输入时钟的下降沿被锁定,因此所有相关规格限制都参考时钟输入的负沿。仅为此器件提供 VBB 引脚,即内部产生的供应电压。对于单端输入情况,将未使用的差分输入连接至 VBB,作为开关参考电压。VBB 还可重新偏置交流耦合输入。使用时,通过 0.01 uF 电容器对 VBB 和 VCC 进行去耦合,并将源电流或汲电流限制为 0.5 mA。不使用时,VBB 应保持开路。

  • 400 ps Typical Propagation Delay
  • 100 ps Device-to-Device Skew
  • 25 ps Within Device Skew
  • Maximum Frequency > 2 GHz Typical
  • The 100 Series Contains Temperature Compensation
  • PECL and HSTL Mode: VCC = 3.0 V to 5.5 V with VEE = 0 V
  • NECL Mode: VCC = 0 V with VEE = -3.0 V to -5.5 V
  • Open Input Default State

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Compliance

Package Type

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MSL Type

MSL Temp (°C)

Container Type

Container Qty.

ON Target

Type

Channels

Input / Output Ratio

Input Level

Output Level

VCC Typ (V)

tJitterRMS Typ (ps)

tskew(o-o) Max (ps)

tpd Typ (ns)

tR & tF Max (ps)

fmaxClock Typ (MHz)

fmaxData Typ (Mbps)

Reference Price

MC100EP14DTG

Active

CAD Model

Pb

A

H

P

TSSOP-20

1

260

TUBE

75

N

Buffer

1

2:1:5

LVDS

ECL

5

0.2

35

0.375

205

2000

-

Price N/A

More Details

MC100EP14DTR2G

Active

CAD Model

Pb

A

H

P

TSSOP-20

1

260

REEL

2500

N

Buffer

1

2:1:5

LVDS

ECL

5

0.2

35

0.375

205

2000

-

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